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3.3V 64/32K X 18
SYNCHRONOUS
FOURPORT? STATIC RAM
IDT70V5388/78
True four-ported memory cells which allow simultaneous
Synchronous Pipelined device
Pipelined output mode allows fast 200MHz operation
High Bandwidth up to 14 Gbps (200MHz x 18 bits wide x
LVTTL I/O interface
High-speed clock to data access 3.0ns (max.)
3.3V Low operating power
Interrupt flags for message passing
Width and depth expansion capabilities
Counter readback on address lines
Features
◆
access of the same memory location
◆
– 64/32K x 18 organization
◆
◆
4 ports)
◆
◆
◆
◆
◆
◆
Port - 1 Logic Block Diagram (2)
R/ W P1
UB P1
CE 0P1
CE 1P1
LB P1
OE P1
I/O 9P1 - I/O 17P1
0
1
1 /0
◆
◆
◆
◆
◆
◆
◆
◆
◆
◆
Counter wrap-around control
– Internal mask register controls counter wrap-around
– Counter-Interrupt flags to indicate wrap-around
Mask register readback on address lines
Global Master reset for all ports
Dual Chip Enables on all ports for easy depth expansion
Separate upper-word and lower-word controls on all ports
272-BGA package (27mm x 27mm 1.27mm ball pitch) and
256-BGA package (17mm x 17mm 1.0mm ball pitch)
Commercial and Industrial temperature ranges
JTAG boundary scan
MBIST (Memory Built-In Self Test) controller
Green parts available, see ordering information
Port 1
I/O
I/O 0P1 - I/O 8P1
Control
TRST
TMS
TCK
TDI
JTAG
Controller
TDO
MRST
A 0P1 - A 15P1 (1)
Addr.
Read
Back
Port 1
Readback
Register
Port 1
Mask
Register
CLKMBIST
,
MBIST
CNTRD P1
MKRD P1
MKLD P1
CNTINC P1
CNTLD P1
Priority
Decision
Logic
Port 1
Counter/
Address
Port 1
Address
Decode
64KX18
Memory
Array
CNTRST P1
Register
NOTE:
CLK P1
MRST
CNTINT P1
R/ W P1
CE 0P1
CE 1P1
CLK P1
MRST
Port 1
Interrupt
Logic
INT P1
5649 drw 01
1. A 15 x is a NC for IDT70V5378.
2. Port 2, Port 3, and Port 4 Logic Blocks are similar to Port 1 Logic Blocks.
?2008 Integrated Device Technology, Inc.
1
OCTOBER 2008
DSC-5649/5
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